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Test Circuits and Waveforms
V DS
BV DSS
L
t P
V DS
VARY t P TO OBTAIN
REQUIRED PEAK I AS
R G
+
V DD
I AS
V DD
V GS
DUT
-
0V
t P
I AS
0.01 ?
0
t AV
Figure 15. Unclamped Energy Test Circuit
V DS
Figure 16. Unclamped Energy Waveforms
V DD
Q g(TOT)
V GS
L
+
V DD
Q gs2
V DS
V GS
V GS = 10V
-
DUT
I g(REF)
V GS = 2V
0
Q g(TH)
I g(REF)
0
Q gs
Q gd
Figure 17. Gate Charge Test Circuit
Figure 18. Gate Charge Waveforms
V DS
R L
V DS
t ON
t d(ON)
90%
t r
t OFF
t d(OFF)
t f
90%
V GS
+
-
V DD
0
10%
10%
R GS
DUT
90%
V GS
50%
50%
V GS
0
10%
PULSE WIDTH
Figure 19. Switching Time Test Circuit
Figure 20. Switching Time Waveforms
? 2003 Fairchild Semiconductor Corporation
FDP047AN08A0 / FDH047AN08A0 Rev. C2
6
www.fairchildsemi.com
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